5322946 liangkangnan 1578984522
一个从零开始写的极简、非常易懂的RISC-V处理器核。
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从零写一个16位处理器,采用自主设计的大黄鸭指令集,单周期3级流水线,8位指令双发射。配套大黄鸭汇编器,简化程序开发。目前主体设计已完成,大家的支持是我前进的动力。
Verilog
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This repo is GenshinCPU From NWPU(NSCSCC First Prize)
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使用DDS芯片AD9914产生线性扫频信号
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基于Xlinx S6芯片的Sobel边沿检测算法实现
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本项目是基于XILINX A7芯片的HDMI控制模块
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Ethernet interfacing and packet processing on FPGAs, starting from a minimum functionality MAC layer design.
Verilog
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ltc2357芯片调试
Verilog
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开源FPGA Lattice的iCE40系列芯片 入门教程
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Verilog
8年多前

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